Lógica Programável: Conceitos em VHDL

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Questão 1/10 - Lógica Programável 
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Os registradores em VHDL são implementados em região de código sequencial dentro de 
uma estrutura PROCESS. 
No caso de um registrador sensível a borda, caso dos flip-flops, o código VHDL que 
identifica uma borda de descida na entrada de clock é: 
Nota: 10.0 
 
A 
 
IF (ck’EVENT AND ck = ‘1’) 
 
B 
 
IF (ck’EVENT AND ck = ‘0’) 
Você assinalou essa alternativa (B) 
Você acertou! 
Rota3 – Tema3 
 
C 
 
IF (NOT ck’STABLE AND ck = ‘1’) 
 
D 
 
IF (ck = ‘0’) 
 
E 
 
IF (ck’STABLE AND ck = ‘0’) 
 
Questão 2/10 - Lógica Programável 
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Os IP cores são blocos de hardware que executam tarefas específicas. 
A tecnologia que possibilita projetar dispositivos FPGA com memória, elementos lógicos 
e um processador IP core em sua arquitetura interna é chamada de: 
Nota: 10.0 
 
A 
 
SOC 
 
B 
 
SOPC 
Você assinalou essa alternativa (B) 
Você acertou! 
Rota6 – Tema1 
javascript:void(0)
javascript:void(0)
 
C 
 
SO 
 
D 
 
ARM 
 
E 
 
RISC 
 
Questão 3/10 - Lógica Programável 
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A configuração em VHDL estabelece o elo entre a declaração de um componente e uma 
entidade de projeto. 
É necessário utilizar a configuração quando o componente possui uma entidade com: 
Nota: 10.0 
 
A 
 
vários pacotes 
 
B 
 
várias constantes 
 
C 
 
vários mapeamentos de portas 
 
D 
 
várias arquiteturas 
Você assinalou essa alternativa (D) 
Você acertou! 
Rota3 – Tema2 
 
E 
 
várias bibliotecas 
 
Questão 4/10 - Lógica Programável 
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Contadores em VHDL podem ser implementados utilizando máquina de estados ou 
utilizando estrutura IF / ELSE sem máquina de estados, sempre utilizando uma entrada de 
clock ativo por borda de subida ou descida. 
No caso do contador utilizando estrutura IF / ELSE sem máquina de estados e que 
permite carregar um valor inicial de contagem, no que diz respeito ao sincronismo com o 
sinal de clock, o reset é __________ e a carga de dados é ____________. 
javascript:void(0)
javascript:void(0)
A opção abaixo que completa corretamente os espaços na ordem em que se apresentam 
é: 
Nota: 10.0 
 
A 
 
síncrono ; paralela síncrona 
 
B 
 
assíncrono ; paralela assíncrona 
 
C 
 
assíncrono ; paralela síncrona 
Você assinalou essa alternativa (C) 
Você acertou! 
Rota4 – Tema3 
 
D 
 
síncrono ; serial síncrona 
 
E 
 
assíncrono ; serial síncrona 
 
Questão 5/10 - Lógica Programável 
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Dado uma unidade lógica e aritmética (ULA) de 3 bits de controle implementada em 
VHDL, em que as 4 primeiras operações são lógicas e as últimas 4 operações são 
aritméticas, considerando uma contagem de 000 a 111 na sua tabela verdade. 
O bit de entrada de controle que define se a operação é lógica ou aritmética é o: 
Nota: 10.0 
 
A 
 
LSB 
LSB significa bit menos significativo, posicionado mais à direita, portanto, faz parte das operações em si, não serve para definir qual tipo de operação é realizada, se lógica ou aritmética. 
 
B 
 
MSB 
Você assinalou essa alternativa (B) 
Você acertou! 
MSB significa bit mais significativo, posicionado mais à esquerda, portanto, é o bit utilizado para definir se uma operação é lógica ou aritmética, conforme a Rota4 – Tema1. 
 
C 
 
USB 
javascript:void(0)
USB não corresponde a uma sigla utilizada para identificação de bits. 
 
D 
 
OSB 
OSB não corresponde a uma sigla utilizada para identificação de bits. 
 
E 
 
ASB 
ASB não corresponde a uma sigla utilizada para identificação de bits. 
 
Questão 6/10 - Lógica Programável 
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Os dados armazenados na memória ROM em VHDL são definidos na arquitetura da 
entidade na região de declarações, antes da palavra reservada BEGIN. 
A classe de objetos utilizada para definir o número de endereços e armazenar os dados 
na memória ROM é: 
Nota: 10.0 
 
A 
 
VARIABLE 
Classe usada para definir objetos que mudam de valor, portanto, não pode ser usada para definir uma memória ROM. 
 
B 
 
CONSTANT 
Você assinalou essa alternativa (B) 
Você acertou! 
Classe correta, conforme a Rota5 – Tema1. 
 
C 
 
GENERIC 
GENERIC não corresponde a uma classe de objetos, mas a uma região de declaração de constantes. 
 
D 
 
SIGNAL 
SIGNAL é uma classe usada para definir sinais, portanto, não pode ser usada para definir uma memória ROM. 
 
E 
 
FILE 
FILE é uma classe usada para definir arquivos, portanto, não pode ser usada para definir uma memória ROM. 
 
javascript:void(0)
Questão 7/10 - Lógica Programável 
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Sobre o conjunto de instruções do microprocessador VHDL apresentado na Aula Teórica 
6. 
A instrução de carga direta do Acumulador (LDdA,n) é executada por meio da leitura do 
dado em hexadecimal 10 apontado por Pc, fazendo o armazenamento no registrador Acc 
do valor que está no endereço de memória apontado por: 
Nota: 0.0Você não pontuou essa questão 
 
A 
 
[Pc-1] 
 
B 
 
[Pc+1] 
Você assinalou essa alternativa (B) 
 
C 
 
[[Pc+1]] 
 
D 
 
[Pg&0] 
Rota6 – Tema3 
 
E 
 
[[Pg&0]] 
 
Questão 8/10 - Lógica Programável 
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Para a realização de testes em VHDL é possível gerar formas de onda para estimular uma 
entidade. 
Os estímulos de teste são armazenados em um vetor declarado como constante cujos 
elementos são do tipo: 
Nota: 10.0 
 
A 
 
ARRAY 
 
B 
 
VECTOR 
 
C 
 
COMPOSITE 
javascript:void(0)
javascript:void(0)
 
D 
 
RECORD 
Você assinalou essa alternativa (D) 
Você acertou! 
Rota5 – Tema5 
 
E 
 
SCALAR 
 
Questão 9/10 - Lógica Programável 
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Sobre circuitos codificadores/decodificadores e multiplexadores em VHDL. 
 
Dadas as seguintes sentenças: 
I – O codificador de prioridade pode ser implementado com construção WHEN ELSE, 
utilizando código concorrente. 
II – O codificador de prioridade pode ser implementado com construção WITH SELECT, 
utilizando código sequencial. 
III – Um multiplexador de 4 entradas com 4 bits cada, considerando o uso do tipo 
BIT_VECTOR, declara cada uma das suas entradas de dados da seguinte forma: IN 
BIT_VECTOR (4 DOWNTO 0). 
IV – Considerando um decodificador BCD para 7 segmentos para um display anodo 
comum, cuja saída é dada na seguinte ordem: hgfedcba. Para mostrar o dígito decimal 4 
com o ponto decimal, o código binário na saída do decodificador é 00011001. 
Quanto à veracidade dessas sentenças, marque a alternativa correta: 
Nota: 10.0 
 
A 
 
V, F, V, V 
 
B 
 
V, V, F, F 
 
C 
 
F, V, V, V 
 
D 
 
F, F, V, V 
 
E 
 
V, F, F, V 
javascript:void(0)
Você assinalou essa alternativa (E) 
Você acertou! 
Rota4 – Tema2 
 
Questão 10/10 - Lógica Programável 
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O NIOS II é o processador software core da Altera. 
O nome do seu barramento interno que interliga todos os seus componentes é: 
Nota: 10.0 
 
A 
 
Altera Switch Fabric 
 
B 
 
Quartus Switch Fabric 
 
C 
 
Avalon Switch Fabric 
Você assinalou essa alternativa (C) 
Você acertou! 
Rota6 – Tema2 
 
D 
 
Avalon Switch Industry 
 
E 
 
Altera Switch Industry 
 
 
javascript:void(0)